天眼查App显示，上海安路信息科技股份有限公司近日公开了一项基于FPGA的时钟同步方法及系统的发明专利（专利号：CN202411247833.8）。该发明旨在通过FPGA内部逻辑实现时钟同步，无需额外的模拟电路，从而降低时钟同步的成本。具体而言，该方法包括获取同步信号的频率和本地时钟信号的周期，利用FPGA的第一内部逻辑对本地时钟信号进行分频处理，生成第一时钟信号。随后，通过FPGA的第二内部逻辑计算第一时钟信号与同步信号之间的相位差和频率差，并根据这些差异调整本地时钟信号，最终实现同步锁定并输出同步后的时钟信号。此技术完全依赖FPGA软逻辑以纯数字方式实现，简化了硬件设计，提升了系统的灵活性和可靠性。

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